1.Combining Software and Hardware Test Generation Methods to Verify VHDL Models

作　　者：Jusas ;Vacius ;Neverdauskas 等

出　　处：Information Technology And Control. 2013 ;42(4):362-368.doi:10.5755/j01.itc.42.4.4261

出版社：Kaunas University of Technology

文章 ID：100225162

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2.Stimuli generation framework for testing multiple processes in VHDL

作　　者：Jusas ;Neverdauskas

出　　处：Information Technology And Control. 2014 ;43(4):440-446.doi:10.5755/j01.itc.43.4.7598

出版社：Kaunas University of Technology

文章 ID：100225186

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3.Combining Software and Hardware Test Generation Methods to Verify VHDL Models

作　　者：Jusas, Vacius ;Neverdauskas, Tomas

出　　处：Engineering Economics. 2013 ;42(4):362-368.doi:10.5755/j01.itc.42.4.4261

出版社：Kaunas University of Technology

文章 ID：203581718

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4.Stimuli generation framework for testing multiple processes in VHDL

作　　者：Jusas, V. ;Neverdauskas, T.

出　　处：Engineering Economics. 2014 ;43(4):440-446.doi:10.5755/j01.itc.43.4.7598

出版社：Kaunas University of Technology

文章 ID：203581902

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5.Stimuli generation framework for testing multiple processes in VHDL

作　　者：V. Jusas ;T. Neverdauskas

出　　处：European Integration Studies. 2014 ;43(4):440-446.doi:10.5755/j01.itc.43.4.7598

出版社：Kaunas University of Technology

文章 ID：232916137

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6.Combining Software and Hardware Test Generation Methods to Verify VHDL Models

作　　者：Vacius Jusas ;Tomas Neverdauskas

出　　处：European Integration Studies. 2013 ;42(4):362-368.doi:10.5755/j01.itc.42.4.4261

出版社：Kaunas University of Technology

文章 ID：232916181

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7.Stimuli generation framework for testing multiple processes in VHDL

作　　者：V. Jusas ;T. Neverdauskas

出　　处：Public Policy And Administration. 2014 ;43(4):440-446.doi:10.5755/j01.itc.43.4.7598

出版社：Kaunas University of Technology

文章 ID：232903806

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8.Combining Software and Hardware Test Generation Methods to Verify VHDL Models

作　　者：Vacius Jusas ;Tomas Neverdauskas

出　　处：Public Policy And Administration. 2013 ;42(4):362-368.doi:10.5755/j01.itc.42.4.4261

出版社：Kaunas University of Technology

文章 ID：232903850

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